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8 interrupção que desvia para o endereço 34 h. 9 interrupção que desvia para o endereço 2C h.  10 usado para expandir a capacidade de interrupção. 11 Reconhecimento de pedido de interrupção. 12-19  Byte menos significativo do endereço e barramento de dados 20 Pino de terra (GND).
40 Pino de alimentação. Vcc = +5 V 39 Requerimento de barramento. Ativo alto. 38 Reconhecimento de HOLD.  Indica que pedido foi aceito. 37 Saída de clock para os demais chips do sistema 36 Reset do sistema.  PC = 0000 h. Interrupções com máscara. 35 1 = memória ou perif. prontos para acesso.  0 = wait
34 Indica se a operação é de entrada/saída ou com memória 33 Com S0 e IO/Mindicam estados do ciclo de máquina 32 Sinal que habilita periférico ou memória para leitura 31 Sinal que habilita periférico ou memória para escrita 30 Sinal para carga da parte baixa do endereço (no latch 74373) 29 - 21  Com S1 e IO/Mindicam estados do ciclo de máquina
Estado do ciclo de máquina Reset x x 3S Hold x x 3S HLT (parada: sai com INT, HOLD ou RESET 0 0 3S reconhecimento de interrupção (INTA) 1 1 1 leitura de porta (instrução IN porta) 0 1 1 escrita em porta (instrução OUT porta) 1 0 1 busca de opcode 1 1 0 leitura de memória 0 1 0 escrita em memória 1 0 0 ESTADO S0 S1 __ IO/M
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  • 30.
  • 32.
  • 33. 8 interrupção que desvia para o endereço 34 h. 9 interrupção que desvia para o endereço 2C h. 10 usado para expandir a capacidade de interrupção. 11 Reconhecimento de pedido de interrupção. 12-19 Byte menos significativo do endereço e barramento de dados 20 Pino de terra (GND).
  • 34. 40 Pino de alimentação. Vcc = +5 V 39 Requerimento de barramento. Ativo alto. 38 Reconhecimento de HOLD. Indica que pedido foi aceito. 37 Saída de clock para os demais chips do sistema 36 Reset do sistema. PC = 0000 h. Interrupções com máscara. 35 1 = memória ou perif. prontos para acesso. 0 = wait
  • 35. 34 Indica se a operação é de entrada/saída ou com memória 33 Com S0 e IO/Mindicam estados do ciclo de máquina 32 Sinal que habilita periférico ou memória para leitura 31 Sinal que habilita periférico ou memória para escrita 30 Sinal para carga da parte baixa do endereço (no latch 74373) 29 - 21 Com S1 e IO/Mindicam estados do ciclo de máquina
  • 36. Estado do ciclo de máquina Reset x x 3S Hold x x 3S HLT (parada: sai com INT, HOLD ou RESET 0 0 3S reconhecimento de interrupção (INTA) 1 1 1 leitura de porta (instrução IN porta) 0 1 1 escrita em porta (instrução OUT porta) 1 0 1 busca de opcode 1 1 0 leitura de memória 0 1 0 escrita em memória 1 0 0 ESTADO S0 S1 __ IO/M
  • 37. Sistema Básico de Temporização Princípio de Operação
  • 38. Diagrama básico de temporização do 8085
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  • 40. Diagrama básico de temporização com período de espera Twait
  • 41. Pino 35 1 = memória ou perif. prontos para acesso. 0 = wait
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