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Sou estudante de Bacharelado em Sistemas de Informação na UFRPE, e Bacharel em Administração pela UPE, formado em julho de 2013. Há 2 anos, trabalho em projetos de pesquisa relacionados a Internet das Coisas, Sistemas Embarcados, Sensoriamento e Desenvolvimento de Hardware, com apoio do CETENE e UFRPE. Atualmente, trabalho no desenvolvimento de um processador de arquitetura RISC-V dedicado à reconhecimento de voz. Para isso, estudei linguagens HDL (VHDL, Verilog/SystemVerilog), bem como a ISA RISC-V. Utilizando uma implementação RISC-V em VHDL como base, até então obtive sucesso na tradução de módulos Divisor e UART para SystemVerilog, devidamente testados, e estou agora fazendo testes ...