1. INSTITUTO TECNOLÓGICO SUPERIOR DE
ZONGOLICA
NOMBRE DE ALUMNO:
ALEJANDRO GAMBINO TZITZIHUA
MATERIA:
ARQUITECTURA DE COMPUTADORAS
GRUPO:
ISC 503

2. Ciclo de instrucciones
Los procesadores son máquinas secuenciales, es decir, su funcionamiento
se basa en ejecutar una tras otra las instrucciones contenidas en memoria.
Estas instrucciones, se encuentran contenidas en memoria como una
ristra de 0 y 1 (para que resulte más fácil su manejo los veremos cómo
dígitos hexadecimales).
El ciclo de instrucción podemos dividirlo en tres partes:
1. Tomar la siguiente instrucción (fetch).
2. Decodificar la instrucción.
3. Ejecutar la instrucción.
1. Tomar la siguiente instrucción (fetch).
El procesador siempre tiene su registro PC (Contador de Programa)
apuntando a la dirección de memoria de la siguiente instrucción a

3. ejecutar. Durante esta fase el procesador extrae la instrucción de la
memoria apuntada por el PC volcando el contenido de este registro al bus
de direcciones y pidiendo una operación de lectura a la memoria.
Simultáneamente a esta petición, el PC se incrementará en una unidad
para apuntar a la siguiente instrucción o bien al primer operando de la
instrucción extraída si esta lo tuviera.
Cuando la memoria está preparada para atender la petición, vuelca el
contenido de la dirección pedida al bus de datos de donde el procesador
recoge el código de operación y lo coloca en un registro especial llamado
Registro de Instrucción (IR).
2. Decodificar la instrucción.
Una vez tiene el código de operación alojado en el IR, el procesador
decodifica éste para saber de qué instrucción se trata y obtiene los
parámetros de la memoria (si los tuviera), incrementando el PC en una
unidad por cada parámetro extraído.
3. Ejecutar la instrucción
Llegado a este paso, el procesador ya sabe de qué instrucción se trata y los
parámetros que necesita, luego simplemente la ejecuta de la forma
apropiada.
Al finalizar este paso finaliza una iteración del ciclo de instrucción,
volveremos al fetch de la siguiente instrucción y así sucesivamente.